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【2h】

Optimizing latency in Xilinx FPGA implementations of the GBT/Erratum: optimizing latency in Xilinx FPGA implementations of the GBT

机译：在GBT /勘误表的Xilinx FPGA实现中优化延迟：在GBT的Xilinx FPGA实现中优化延迟

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An Erratum for this article has been published in 2011 JINST 6 E05001

机译：本文的勘误已于2011年JINST 6 E05001发布

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作者
Muschter, S.; Baron, S.; Bohm, C.; Cachemiche, J.-P.; Soos, C.;
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作者单位

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年度 2010
总页数
原文格式 PDF
正文语种 en
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